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#objdump: -dr --prefix-addresses --show-raw-insn
#name: VFP Double-precision instructions
#as: -mfpu=vfp
# Test the ARM VFP Double Precision instructions
.*: +file format .*arm.*
Disassembly of section .text:
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0+0d4 <[^>]*> eeb10b41 (vneg\.f64|fnegd) d0, d1
0+0d8 <[^>]*> eeb10b42 (vneg\.f64|fnegd) d0, d2
0+0dc <[^>]*> eeb10b4f (vneg\.f64|fnegd) d0, d15
0+0e0 <[^>]*> eeb11b40 (vneg\.f64|fnegd) d1, d0
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0+0fc <[^>]*> ee310b00 (vadd\.f64|faddd) d0, d1, d0
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0+10c <[^>]*> ee302b00 (vadd\.f64|faddd) d2, d0, d0
0+110 <[^>]*> ee30fb00 (vadd\.f64|faddd) d15, d0, d0
0+114 <[^>]*> ee39cb05 (vadd\.f64|faddd) d12, d9, d5
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0+11c <[^>]*> eeb70ac1 (vcvt\.f64\.f32|fcvtds) d0, s2
0+120 <[^>]*> eeb70aef (vcvt\.f64\.f32|fcvtds) d0, s31
0+124 <[^>]*> eeb71ac0 (vcvt\.f64\.f32|fcvtds) d1, s0
0+128 <[^>]*> eeb72ac0 (vcvt\.f64\.f32|fcvtds) d2, s0
0+12c <[^>]*> eeb7fac0 (vcvt\.f64\.f32|fcvtds) d15, s0
0+130 <[^>]*> eef70bc0 (vcvt\.f32\.f64|fcvtsd) s1, d0
0+134 <[^>]*> eeb71bc0 (vcvt\.f32\.f64|fcvtsd) s2, d0
0+138 <[^>]*> eef7fbc0 (vcvt\.f32\.f64|fcvtsd) s31, d0
0+13c <[^>]*> eeb70bc1 (vcvt\.f32\.f64|fcvtsd) s0, d1
0+140 <[^>]*> eeb70bc2 (vcvt\.f32\.f64|fcvtsd) s0, d2
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0+1a0 <[^>]*> ed900b00 vldr d0, \[r0\]
0+1a4 <[^>]*> ed900bff vldr d0, \[r0, #1020\].*
0+1a8 <[^>]*> ed100bff vldr d0, \[r0, #-1020\].*
0+1ac <[^>]*> ed901b00 vldr d1, \[r0\]
0+1b0 <[^>]*> ed902b00 vldr d2, \[r0\]
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0+24c <[^>]*> 0e832b0e (vdiveq\.f64|fdivdeq) d2, d3, d14
0+250 <[^>]*> 0e0d4b0c (vmlaeq\.f64|fmacdeq) d4, d13, d12
0+254 <[^>]*> 0e165b0b (vnmlseq\.f64|fmscdeq) d5, d6, d11
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0+25c <[^>]*> 0e098b4a (vmlseq\.f64|fnmacdeq) d8, d9, d10
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